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Cypress Semiconductor CY7C1297H Manuel d'utilisateur Page 12

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CY7C1297H
Document #: 38-05669 Rev. *B Page 12 of 15
Read/Write Timing
[16, 18, 19]
Notes:
18. The data bus (Q) remains in High-Z following a Write cycle unless an ADSP
, ADSC, or ADV cycle is performed.
19. GW
is HIGH.
Timing Diagrams (continued)
CYC
t
CL
CLK
t
ADH
t
ADS
ADDRESS
t
CH
t
AH
t
AS
A2
t
CEH
t
CES
Single WRITE
D(A3)
A3 A4
BURST READBack-to-Back READs
High-Z
Q(A2)
Q(A4) Q(A4+1) Q(A4+2) Q(A4+3)
t
WEH
t
WES
t
OEHZ
t
DH
t
DS
t
CDV
t
OELZ
A1 A5 A6
D(A5) D(A6)
Q(A1)
Back-to-Back
WRITEs
DON’T CARE UNDEFINED
ADSP
ADSC
BWE, BW[A:B]
CE
ADV
OE
Data In (D)
Data Out (Q)
[+] Feedback
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